雙DSP結(jié)構(gòu)的捷聯(lián)控制與解算系統(tǒng)設(shè)計(jì)

設(shè)計(jì)了基于雙DSP結(jié)構(gòu)的捷聯(lián)控制與解算系統(tǒng).該系統(tǒng)以高性能的浮點(diǎn)處理器TMS320VC33作為捷聯(lián)系統(tǒng)實(shí)時解算的核心,以TMS320VC5402作為通道控制、數(shù)據(jù)采集的控制核心.并結(jié)合FPGA的組合邏輯和時序邏輯,構(gòu)成了高集成度的嵌入式系統(tǒng).該系統(tǒng)具有采樣速度快、浮點(diǎn)處理精度高、穩(wěn)定性好等特點(diǎn).可以充分滿足捷聯(lián)導(dǎo)航系統(tǒng)的要求.

作 者： 高延濱 孫華 曾建輝 GAO Yan-bin SUN Hua ZENG Jian-hui   作者單位： 哈爾濱工程大學(xué),哈爾濱,150001  刊 名： 微計(jì)算機(jī)信息  PKU 英文刊名： CONTROL & AUTOMATION  年，卷(期)： 2008 24(28)  分類號： V249.3  關(guān)鍵詞： 捷聯(lián)慣導(dǎo)系統(tǒng)   DSP   FPGA   HPI  

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